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3.3 学习UVM中的uvm_driver 类分为几步？

news 2025/6/21 20:33:54

文章目录

前言
1. 定义
2. 核心功能
3. 适用场景
4. 使用方法
5. 完整代码示例
- 5.1 事务类定义
- 5.2 Driver 类定义
- 5.3 Sequencer 类定义
- 5.4 测试平台
6. 代码说明
7. 总结

前言

以下是关于 UVM 中 uvm_driver 的详细解释、核心功能、适用场景、使用方法以及一个完整的代码示例：

1. 定义

uvm_driver 是 UVM（Universal Verification Methodology）中的一个重要组件类，用于驱动事务（transaction）到设计（DUT）的接口。它通常与 uvm_sequencer 配合使用，从 uvm_sequencer 获取事务并将其转换为信号级别的激励，施加到 DUT 的接口上。

uvm_driver 的主要特点：

从 uvm_sequencer 获取事务。
将事务转换为信号级别的激励。
是 UVM 测试平台中与 DUT 交互的关键组件。

2. 核心功能

uvm_driver 提供了以下核心功能：

事务获取：通过 get_next_item() 或 try_next_item() 方法从 uvm_sequencer 获取事务。
事务处理：将事务转换为信号级别的激励，并驱动到 DUT 的接口。
事务完成：通过 item_done() 方法通知 uvm_sequencer 当前事务处理完成。
与 Sequencer 的通信：管理与 uvm_sequencer 的通信，确保事务的顺序和同步。

3. 适用场景

uvm_driver 通常用于以下场景：

接口驱动：用于驱动 DUT 的输入接口（如 AXI、APB、SPI 等）。
协议实现：实现特定的总线协议或通信协议。
激励生成：将高层次的事务转换为低层次的信号激励。

4. 使用方法

使用 uvm_driver 的步骤如下：

定义类：从 uvm_driver 派生一个类，并定义其属性和方法。
实现 run_phase：在 run_phase 中实现事务的获取、处理和完成逻辑。
与 Sequencer 连接：在测试平台中将 uvm_driver 与 uvm_sequencer 连接。
驱动事务：在 run_phase 中将事务转换为信号激励并驱动到 DUT。

5. 完整代码示例

以下是一个完整的代码示例，展示如何使用 uvm_driver 驱动事务到 DUT 的接口。

5.1 事务类定义

// 定义一个从 uvm_sequence_item 派生的事务类
class my_transaction extends uvm_sequence_item;rand bit [7:0] data;rand bit [3:0] addr;bit           valid;// 注册类到 UVM 工厂`uvm_object_utils(my_transaction)// 构造函数function new(string name = "my_transaction");super.new(name);endfunction// 实现 print 方法virtual function void do_print(uvm_printer printer);printer.print_field("data",  this.data,  8);printer.print_field("addr",  this.addr,  4);printer.print_field("valid", this.valid, 1);endfunctionendclass

5.2 Driver 类定义

// 定义一个从 uvm_driver 派生的驱动类
class my_driver extends uvm_driver #(my_transaction);// 注册类到 UVM 工厂`uvm_component_utils(my_driver)// 构造函数function new(string name, uvm_component parent);super.new(name, parent);endfunction// 实现 run_phasevirtual task run_phase(uvm_phase phase);forever begin// 从 sequencer 获取事务seq_item_port.get_next_item(req);// 打印事务`uvm_info("DRIVER", $sformatf("Driving transaction: data=0x%0h, addr=0x%0h, valid=%b", req.data, req.addr, req.valid), UVM_LOW)// 将事务转换为信号激励（这里用延时模拟驱动过程）#10;// 通知 sequencer 事务处理完成seq_item_port.item_done();endendtaskendclass

5.3 Sequencer 类定义

// 定义一个从 uvm_sequencer 派生的 sequencer 类
class my_sequencer extends uvm_sequencer #(my_transaction);// 注册类到 UVM 工厂`uvm_component_utils(my_sequencer)// 构造函数function new(string name, uvm_component parent);super.new(name, parent);endfunctionendclass

5.4 测试平台

// 测试平台
module testbench;initial begin// 创建 env 类class my_env extends uvm_env;my_driver    driver;my_sequencer sequencer;// 注册类到 UVM 工厂`uvm_component_utils(my_env)// 构造函数function new(string name, uvm_component parent);super.new(name, parent);endfunction// 构建组件virtual function void build_phase(uvm_phase phase);driver    = my_driver::type_id::create("driver", this);sequencer = my_sequencer::type_id::create("sequencer", this);endfunction// 连接组件virtual function void connect_phase(uvm_phase phase);driver.seq_item_port.connect(sequencer.seq_item_export);endfunctionendclass// 创建测试类class my_test extends uvm_test;my_env env;// 注册类到 UVM 工厂`uvm_component_utils(my_test)// 构造函数function new(string name, uvm_component parent);super.new(name, parent);endfunction// 构建组件virtual function void build_phase(uvm_phase phase);env = my_env::type_id::create("env", this);endfunction// 运行测试virtual task run_phase(uvm_phase phase);phase.raise_objection(this);#100; // 模拟测试运行时间phase.drop_objection(this);endtaskendclass// 启动测试initial beginrun_test("my_test");endend
endmodule